MPC8533E

The MPC8533E PowerQUICC^® III communications processor offers high level of integration and performance for Ethernet-only or PCIe interworking applications, such as enterprise networking and advanced multi-function printer (MFP) and imaging applications.

Includes enhanced peripherals, an integrated security engine, and a wide range of high-speed connectivity options
Supports complex, computationally demanding control plane processing tasks
Comes optimized for power sensitive applications
Provides a flexible SoC platform to accelerate time-to-market
Simplifies board design

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データシート

リファレンス・マニュアル

製品詳細

ブロック図

MPC8533E Block Diagram

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Features

Embedded e500 core, initial offerings up to 667 MHz, targeting up to 1.0 GHz

Dual dispatch superscalar, 7-stage pipeline design with out-of-order issue and execution
2,240 MIPS at 1.0 GHz (estimated Dhrystone 2.1)
36-bit physical addressing

Enhanced hardware and software debug support

Double-precision embedded scalar and vector floating-point APUs

Memory management unit (MMU)

Double-precision embedded scalar and vector floating-point APUs

Integrated L1/L2 cache

L1 cache—32 KB data and 32 KB instruction cache with line-locking support
L2 cache—256 KB (8-way set associative); 256/128/64/32 KB can be used as SRAM
L1 and L2 hardware coherency
L2 cache and I/O transactions can be stashed into L2 cache regions

Integrated DDR memory controller with full ECC support, offering:

200 MHz clock rate (400 MHz data rate), 64-bit, 2.5V/2.6V I/O, DDR SDRAM
267 MHz clock rate (up to 533 MHz data rate), 64-bit, 1.8V I/O, DDR2 SDRAM

Integrated security engine supporting DES, 3DES, MD-5, SHA-1/2, AES, RSA, RNG, Kasumi F8/F9 and ARC-4 encryption algorithms

Two on-chip Three Speed Ethernet controllers (ETSECs) supporting 10 Mbps, 100 Mbps and 1 Gbps Ethernet/IEEE^{^®} 802.3 networks with MII, RMII, RGMII, and RTBI physical interfaces:

TCP/UDP/IP checksum acceleration
Advanced QoS features

General-purpose input/output (GPIO)

PCI Express high-speed interconnect interfaces, supporting combinations of dual x4 and single x1 PCI Express

On-chip network (OCeaN) switch fabric

PCI interface support

32-bit PCI 2.2 bus controller (up to 66MHz, 3.3V I/O)

Local bus

166 MHz, 32-bit, 3.3V I/O, local bus with memory controller

Integrated four-channel DMA controller

Multiplexed 32-bit address and data operating up to 133 MHz
32-, 16- and 8-bit port sizes controlled by on-chip memory controller

Dual I²C and DUART support

Dual I²C interfaces (controller or target mode)

Programmable interrupt controller (PIC)

IEEE 1149.1 JTAG test access port

1.0V core voltage with 3.3V and 2.5V I/O

783-pin FC-BGA package

部品番号： MPC8533EVJALFA, MPC8533EVJANGA, MPC8533EVJAQGA, MPC8533EVTALFA, MPC8533EVTANGA, MPC8533EVTARJA, MPC8533VJALFA, MPC8533VJAQGA, MPC8533VTALFA.

購入/パラメータ

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設計・リソース

デザイン・ファイル

クイック・リファレンス設計・ファイルの種類.

1 設計・ファイル

完全な内訳を受け取ります。 製品の設置面積などについては、 eCad ファイル.

^{プリント基板と回路図}
OrCAD Design Files for the MPC8544 and MPC8533

ZIP改訂 0May 2, 2008 00:00:0026.3 KBMPC8544ORCAD
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ハードウェア

クイック・リファレンスボードタイプ.

2 ハードウェア提供

^{エミュレータ、プローブ、プログラマ}
Power Architecture^® processor ( COP ) Probe Tips for CodeWarrior^® TAP

CWH-CTP-COP-YE
^{エミュレータ、プローブ、プログラマ}
CodeWarrior^® TAP

CW_TAP

ソフトウェア

クイック・リファレンスソフトウェア・タイプ.

3 ソフトウェア・ファイル

^{設定ツール}
UPM Tool for PowerQUICC^® II Pro and PowerQUICC III Processors

ZIP改訂 2.3Nov 7, 2007 00:00:002.7 MBLBCUPMIBCG
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^{BSPとデバイスドライバ}
Linux BSP for Freescale MPC8544

ISO改訂 FINALJun 2, 2008 00:00:001294070 KBCWF-MPC8544
サインインが必要です
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^{開発IDEと構築ツール}
CodeWarrior^® Development Suites for Networked Applications

ダウンロード・オプション

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MPC8533E PowerQUICC® III Processor

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