S32G車載ネットワーク・プロセッシング評価ボードのスタート・ガイド
最終更新日時：
2020-08-17 10:28:00サポート
S32G2 Vehicle Networking Evaluation Board
このドキュメントの内容
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パッケージの内容
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ソフトウェアの入手
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接続
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ビルドと実行
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お客様の S32G2 Vehicle Networking Evaluation Board
1. パッケージの内容
2. ソフトウェアの入手
2.1 コンソール用のTera Termをインストールする
Tera Termは、UTF-8プロトコルをサポートするオープン・ソースの無料ソフトウェア・ターミナル・エミュレータです。TTSSHはSSH2プロトコルをサポートするようになりました（元のバージョンはSSH1をサポートしています）。
現在、Tera Termの後継バージョンであるTera Term Pro 2.3が配布されています。これは元の制作者によって公認されています。
2.2 FTDI CDM WHQLドライバをインストールする
FTDI CDM v2.12.28 WHQLドライバは、FTDIチップからのシリアル設定のために使用されます。
2.4 Packet Senderアプリケーションをインストールする
ネットワーク・パケット（TCP、UDP、SSL）を送受信するための無料のユーティリティです。
3. 接続
動作テストをしてみましょう。
3.1 S32Gのソケットとヒートシンクを取り付ける
- S32G-PROCEVB-S：S32Gプロセッサ・モジュール、Ironwood Electronics SG-BGA-6124ソケット付き
- M4159ヒートシンク
- 六角レンチ
- Timiy Vacuum Pen Tool
ビデオを参考に、ソケットとヒートシンクを取り付けます。ステップ・バイ・ステップ・ガイドを参考にすることもできます。
- ソケットのネジを左方向に回して、ソケットの上部を緩めます。
- ソケットのカバーを左方向に回して持ち上げ、取り外します。それを脇に置いておきます。
- Vacuum Pen Toolを使用してソケットから圧力プレートを引き上げ、取り外します。それを脇に置いておきます。
- 4. Vacuum Pen Toolを使用してS32Gデバイスを引き上げ、ソケット・ベースに置きます。
- 六角レンチを使って、ソケット・カバーのネジを完全に取り外します。
- Vacuum Pen Toolを使用して、S32Gデバイスの上に圧力プレートを取り付けます。
- ソケット・カバーを元の位置に戻し、右方向に回して所定の位置にロックします。
- ヒートシンクを時計回りにゆっくりと回し、ヒートシンクが圧力プレートに触れたら一度止めます。さらに1/4回転させて、密着させます。ソケットに過度の負荷がかからないように注意してください。
注意
ヒートシンクに大きな力をかけないでください。
取り付けが完了すると、次の写真のようになります。
3.2 12 V電源を接続する
S32G-PROCEVB-SがS32GRV-PLATEVBにスタックされている場合：
S32G-PROCEVB-SのジャンパJ96を1-2の位置に取り付け、S32GRV-PLATEVBにのみ電源を供給する必要があります。
S32GRV-PLATEVBの12 V電源ジャックP3に電源を接続します。
S32G-PROCEVB-Sをスタンドアロンで使用する場合：
ジャンパJ96を2-3の位置に取り付ける必要があります。
S32G-PROCEVB-Sの12 V電源ジャックP1に電源を接続します。
4. ビルドと実行
4.1 Tera Term 4のコンソールをセットアップする
- Windows PCでTera Termを開きます。
- S32G-PROCEVB-Sのmicro USB
J58を接続するシリアル・ポートを選択し、［OK］をクリックします。 - ［Setup（設定）］>［Serial Port（シリアル・ポート）］の順に選択し、ボーレートとして
115200を選択します
4.2 S32G-VNP-EVBの電源をオンにする
S32GRV-PLATEVBの電源スイッチSW1、およびS32G-PROCEVB-Sの電源スイッチSW10をオンにします。
4.3 診断を実行する
診断ユーティリティは、SDカードから自動的に実行されます。
Tera Termのコンソール表示に、診断テストのステータスが表示されます。
SDカード・イメージのログ
S32GRV-PLATEVBの電源スイッチSW1、およびS32G-PROCEVB-Sの電源スイッチSW10をオンにします。
SDカード・イメージのログ
NXPでは初めて使用するユーザー向けに、データのログ作成の参考となるよう、S32G-VNP-EVBと32G-VNP-EVBのイメージが保存されたSDカードを提供しています
Diagnostic Test Release 201909XX
CPU: NXP S32G
Board: S32G274A Board
MC_CGM_0 Clock Mux 0 -> XBAR_CLK (Core Clock)
CORE_DFS_1 Clock -> MC_CGM_0 Clock Mux 0
CORE_VCO Clock -> CORE_DFS_1 Clock
FXOSC -> CORE_VCO Clock
FXOSC: 40000000Hz
CORE_VCO Clock: 2000000000Hz
CORE_DFS Clock: 1000000000Hz
XBAR_CLK: 500000000Hz
Test#1: Setup Init - OK
Test#2: Running LINFLEXD Test
FXOSC -> PERIPH_PLL_PHI3_CLK
FXOSC: 40000000Hz
MC_CGM_0 Clock Mux 8 -> LIN_CLK
LIN CLK = 80000000Hz
LIN 0 Mode: UART
UART 0 Mode: 8-Bit Mode
UART 0 Baud Rate: 115273bps
UART 0 TX_INT: Enabled
UART 0 RX_INT: Enabled
UART 0 SIUL2 Settings: PK15, PL00
Testing LINFLEX Rx
Press enter to continue
Test#2: Test OK
Test#3: Running STM Test
STM CLK = XBAR_CLK
STM Instance: 0
STM 0 Channel: 0
STM 0 Ticks: 3855
STM 0 NVIC ID: 24
STM CLK = XBAR_CLK
STM Instance: 0
STM 0 Channel: 1
STM 0 Ticks: 3855
STM 0 NVIC ID: 24
STM CLK = XBAR_CLK
STM Instance: 0
STM 0 Channel: 2
STM 0 Ticks: 3855
STM 0 NVIC ID: 24
STM CLK = XBAR_CLK
STM Instance: 0
STM 0 Channel: 3
STM 0 Ticks: 3855
STM 0 NVIC ID: 24
Test#3: Test OK
Test#4: Running PIT Test
PIT CLK = XBAR_CLK
PIT Instance: 0
PIT 0 Counter: DOWN
PIT 0 Timer: 0
PIT 0 NVIC ID: 53
PIT 0 Ticks: 4096
PIT CLK = XBAR_CLK
PIT Instance: 0
PIT 0 Counter: DOWN
PIT 0 Timer: 1
PIT 0 NVIC ID: 53
PIT 0 Ticks: 4096
PIT CLK = XBAR_CLK
PIT Instance: 0
PIT 0 Counter: DOWN
PIT 0 Timer: 2
PIT 0 NVIC ID: 53
PIT 0 Ticks: 4096
PIT CLK = XBAR_CLK
PIT Instance: 0
PIT 0 Counter: DOWN
PIT 0 Timer: 3
PIT 0 NVIC ID: 53
PIT 0 Ticks: 4096
PIT CLK = XBAR_CLK
PIT Instance: 0
PIT 0 Counter: DOWN
PIT 0 Timer: 4
PIT 0 NVIC ID: 53
PIT 0 Ticks: 4096
PIT CLK = XBAR_CLK
PIT Instance: 0
PIT 0 Counter: DOWN
PIT 0 Timer: 5
PIT 0 NVIC ID: 53
PIT 0 Ticks: 4096
PIT CLK = XBAR_CLK
PIT Instance: 0
PIT 0 Counter: DOWN
PIT 0 Timer: 6
PIT 0 NVIC ID: 53
PIT 0 Ticks: 4096
Test#4: Test OK
Test#5: Running SWT Test
SWT CLK = XBAR_CLK
SWT Instance: 0
SWT 0 Counter: UP
SWT 0 NVIC ID: 14
SWT 0 Time Out Value: 392400
Test#5: Test OK
Test#6: Running I2C_0 Test
I2C CLK source= XBAR_DIV3_CLK
I2C CLK = 166666666Hz
FXOSC -> CORE_VCO Clock
FXOSC: 40000000Hz
CORE_VCO Clock -> CORE_DFS_1 Clock
CORE_DFS Clock: 1000000000Hz
CORE_DFS_1 Clock -> XBAR Clock
XBAR_CLK: 500000000Hz
I2C 0 Mode: Controller
I2C Target Address = 0xA0
Test#6: Test OK
Test#7: Running DSPI_5 Test
PERIPH_PLL_PHI7_CLK -> DSPI CLK
FXOSC -> PERIPH_PLL_PHI7_CLK
FXOSC: 40000000Hz
DSPI CLK = 1Hz
DSPI 5 Mode: CONTROLLER
DSPI 5 Frame Size: 7Byte
DSPI 5 CPOL : 0
DSPI 5 CPHA : 1
DSPI 5 Loopback with DSPI 1
DSPI 5 Data Length: 8 Bytes
Test#7: Test OK
Test#8: Running GMAC RX Test
GMAC No of Receive Descriptors: 5
GMAC RX NVIC ID: 59
GMAC Buffer Max Length: 1536
ARP Packets Received: 0
ICMP Packets Receive: 0
UDP Packets Received: 2
TCP Packets Received: 0
Unidentified IPv4 Packets Received: 0
Unidentified Packets Received: 3
Test#8: Test OK
Test#9: Running GMAC TX Test
GMAC Mode: RGMII
GMAC RX CLK Direction: PHY to MAC
GMAC TX CLK Direction: MAC to PHY
GMAC Speed: 1Gbps
PERIPH_PLL_PHI5_CLK -> GMAC TX CLK
FXOSC -> PERIPH_PLL_PHI5_CLK
FXOSC: 40000000Hz
GMAC TX CLCK: 133333334Hz
GMAC_EXT_RX_CLK -> GMAC RX CLK
GMAC Communication Mode: Full Duplex
GMAC DMA channel: 0
GMAC DMA Burst Size: 16Bytes
GMAC Source MAC: 0:4:9F:22:E:B0
GMAC Destination MAC: FF:FF:FF:FF:FF:FF
GMAC Source IP: 192.168.0.10
GMAC Destination IP: 192.168.0.11
GMAC Source Port: 2001
GMAC Destination Port: 12345
GMAC No of Transmit Descriptors: 50
GMAC Packet Type: UDP
Test#9: Test OK
Test#10: Running LLCE CAN Loopback Tests
FXOSC -> CAN CLK
FXOSC: 40000000Hz
CAN CLK = 40000000Hz
LLCE_CAN_2 Loopback with LLCE_CAN_3
LLCE_CAN 2&3 ID Type: Standard
LLCE_CAN 2&3 Data Size: 32 Bytes
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Running LLCE CAN 2 & 3 Test: Test OK
Test#11: Running LLCE LIN loopback Tests
FXOSC -> PERIPH_PLL_PHI3_CLK
FXOSC: 40000000Hz
MC_CGM_0 Clock Mux 8 -> LIN_BAUD_CLK
LLCE_LIN_BAUD_CLK = 83333334Hz
LLCE_LIN_0 connected with MPC5748G DEVKIT LIN_0
ID : 0x1
Data Size: 8 Bytes
LLCE_LIN_1 connected with MPC5748G DEVKIT LIN_0
ID : 0x1
Data Size: 8 Bytes
LLCE_LIN_2 connected with MPC5748G DEVKIT LIN_0
ID : 0x1
Data Size: 8 Bytes
LLCE_LIN_3 connected with MPC5748G DEVKIT LIN_0
ID : 0x1
Data Size: 8 Bytes
Running LLCE LIN 0 Test
LLCE LIN 0 message transmitted, Check the received data on follower
Running LLCE LIN 1 Test
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Running LLCE LIN 2 Test
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Running LLCE LIN 3 Test
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Running LLCE LIN 0 Test
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